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SALAD: Evaluación sistemática del desaprendizaje automático en el diseño de hardware asistido por LLM

Created by
  • Haebom

Autor

Zeng Wang, Minghao Shao, Rupesh Karn, Likhitha Mankali, Jitendra Bhandari, Ramesh Karri, Ozgur Sinanoglu, Muhammad Shafique, Johann Knechtel

Describir

Los Modelos de Lenguaje a Gran Escala (LLM) ofrecen capacidades innovadoras para la automatización del diseño de hardware, incluyendo la generación de código Verilog. Sin embargo, también plantean importantes desafíos para la seguridad de los datos, como la contaminación de los datos de evaluación Verilog, la fuga de información sobre propiedad intelectual (PI) en el diseño y el riesgo de generación maliciosa de Verilog. Este artículo presenta SALAD, una evaluación integral que aprovecha el desaprendizaje automático para mitigar estas amenazas. SALAD permite la eliminación selectiva de benchmarks contaminados, artefactos de diseño y PI sensibles, o patrones de código malicioso de LLM preentrenados sin necesidad de un reentrenamiento completo.

Takeaways, Limitations

Takeaways:
Reducción de riesgos de seguridad de datos en diseños de hardware basados ​​en LLM utilizando técnicas de aprendizaje automático.
Eliminar selectivamente datos específicos sin necesidad de volver a entrenarlos por completo
Protección contra puntos de referencia contaminados, direcciones IP confidenciales y malware
Limitations:
No se proporcionó información específica Limitations en el documento
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