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ProtocolLLM: Punto de referencia RTL para la generación de protocolos de comunicación SystemVerilog

Created by
  • Haebom

Autor

Arnav Sheth, Ivaxi Sheth, Mario Fritz

Describir

Este artículo evalúa la capacidad de los modelos de lenguaje a gran escala (LLM) desarrollados recientemente para generar lenguajes de descripción de hardware (HDL), especialmente código SystemVerilog. A diferencia de los lenguajes de programación generales, los HDL presentan estrictas restricciones de semántica de tiempo, concurrencia y sintetizabilidad, lo que dificulta la generación de código. En este artículo, presentamos un nuevo punto de referencia, ProtocolLLM, para evaluar la capacidad de generación de código SystemVerilog de LLM de código abierto y de vanguardia para diversos protocolos de comunicación, componentes esenciales de sistemas embebidos y SoC. La evaluación se centra en la corrección temporal, así como en la sintetizabilidad y la corrección sintáctica. Como resultado, demostramos que la mayoría de los modelos no generan código SystemVerilog para protocolos de comunicación que cumplen con las restricciones de tiempo.

Takeaways, Limitations

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Takeaways:
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Presentamos claramente las limitaciones de la generación de código HDL utilizando LLM y sugerimos futuras direcciones de investigación.
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El punto de referencia ProtocolLLM proporciona un estándar para evaluar objetivamente el rendimiento de generación de código HDL.
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Proporciona una comprensión en profundidad de la capacidad de generación de código HDL de LLM al presentar criterios de evaluación multifacéticos, incluida la precisión de tiempo.
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Limitations:
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El alcance de la evaluación actual se limita a un conjunto limitado de protocolos de comunicación.
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Es necesario evaluar el desempeño de LLM para tareas de diseño HDL más complejas y diversas.
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La aplicabilidad de LLM a otras etapas del flujo de diseño basado en HDL, como el desarrollo del banco de pruebas, la verificación basada en afirmaciones y el cierre temporal, requiere más estudios.
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