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Voltage Mode Winner-Take-All Circuit for Neuromorphic Systems

Created by
  • Haebom

저자

Abdullah M. Zyarah, Dhireesha Kudithipudi

개요

본 논문은 저전력 소모를 특징으로 하는 뉴로모픽 컴퓨팅의 온디바이스 학습 기능에 대한 최근 발전을 바탕으로, k-winner 및 히스테리시스 특성을 달성하도록 구성될 수 있는 winner-take-all 회로를 제안합니다. IBM 65nm 노드에서 시뮬레이션된 이 회로는 1000개의 입력을 처리하는 동안 34.9 μW의 전력을 소모하고 10.4 ns의 지연 시간을 보였습니다. 공간 필터링 및 분류 작업에서의 유용성을 입증하였습니다.

시사점, 한계점

시사점: 저전력, 고속의 winner-take-all 회로 설계를 통해 뉴로모픽 컴퓨팅의 효율성 향상에 기여. 공간 필터링 및 분류 등 다양한 응용 분야에 활용 가능성 제시.
한계점: IBM 65nm 노드에서의 시뮬레이션 결과만 제시되어 실제 구현 및 성능 검증이 필요. 회로의 확장성 및 다양한 입력 크기에 대한 성능 분석 추가 필요. 다른 winner-take-all 회로와의 비교 분석 부족.
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